韩国无晶圆厂半导体公司TLi采用Arasan的IP产品实现成功流片

Tli采用Arasan的UFS IP实现芯片流片
TLi采用Arasan的通用闪存(UFS)知识产权(IP)产品实现了芯片设计的出货,该公司之前获得了Arasan的UFS设备控制器IP及支持高达Gear 3速率的MPHY等产品的授权。TLi是最新一家使用Arasan的UFS Total IP解决方案成功实现芯片设计的公司。

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MIPS CPU持续挑战极限拓展高低端产品阵容

适用于高性能、深度嵌入式应用的新款32位CPU,以及顶级64位处理器为日益强大的CPU IP产品组合再添新成员
Imagination Technologies宣布,随着MIPS Warrior CPU以其日益丰富的产品组合与独特的技术蓝图渐获市场肯定,将为此产品线再添令人惊艳的新成员。更趋完备的高效MIPS CPU产品组合将能协助数量日益增加的授权客户,包括现有的以及新的客户,选择可充分满足其差异化特性组合、性能与业务目标的解决方案。

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ARM与中芯国际针对移动与消费应用扩展28纳米制程工艺IP合作

为高性能系统级芯片设计提供创新IP支持
ARM与中国内地规模最大、技术最先进的集成电路晶圆代工企业中芯国际(纽约交易所:SMI;香港联交所:981)今日共同宣布,双方针对ARM® Artisan® 物理IP签订合作协议,为中芯国际的28纳米poly SiON(PS)制程工艺提供高性能、高密度、低功耗的系统级芯片(SoC)设计支持。

力旺电子与中芯国际联手布局技术发展

力旺电子与中国内地规模最大、技术最先进的集成电路晶圆代工企业中芯国际,共同宣布,已联手扩大在非易失性内存技术内存技术上的发展布局,合作制程涵盖0.35微米至40纳米等,横跨 NeoBit、NeoFuse、NeoEE 与 NeoMTP 等单次与多次可程序嵌入式非易失性内存技术 (eNVM)。

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瞄准可穿戴和物联网!Imagination发布全球第一款Wi-Fi、蓝牙和FM组合IP

具高度可配置性的 Ensigma Series4 RPU 系列内核可支持 802.11ac 和 Bluetooth 4.0 标准,能为移动、可穿戴、IoT 等设备提供独特的低功耗 SoC 解决方案

Imagination Technologies (IMG.L) 今天宣布,推出全球第一款将 Wi-Fi、Bluetooth 4.0 和 FM 接收器结合在单一可配置解决方案上的 IP 产品。运用这一整合技术,新的 Ensigma Series4 ‘Explorer’无线电处理器(RPU)系列内核将能为各种瞄准下一代移动、可穿戴、IoT 和其他连网产品的 SoC 提供理想的解决方案。

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高清Full HD FIFO DRAM的工作原理介绍

Full HD FIFO DRAM(AVERLOGIC AL460),顾名思义就是应用于两个主动组件之间的影像暂储存内存.当Write enable写入智能脚位工作启动时,Read-clock 写入频率输入同步启动时,那影像的数据(video data)就会从低到高位输入.在FIFO内部,内存的Address就会从write pointer (写入指标)到read pointer(读出指标)依序排列.当每个读出指标完成动作后,读出指标就会到下一个内存地址继续工作.若在reset 重置状况下,两者指标(write pointer, read pointer) 就会回到第一个内存地址.

高清Full HD FIFO DRAM的工作原理介绍

Full HD FIFO DRAM(AVERLOGIC AL460),顾名思义就是应用于两个主动组件之间的影像暂储存内存.当Write enable写入智能脚位工作启动时,Read-clock 写入频率输入同步启动时,那影像的数据(video data)就会从低到高位输入.在FIFO内部,内存的Address就会从write pointer (写入指标)到read pointer(读出指标)依序排列.当每个读出指标完成动作后,读出指标就会到下一个内存地址继续工作.若在reset 重置状况下,两者指标(write pointer, read pointer) 就会回到第一个内存地址.

高清Full HD FIFO DRAM的工作原理介绍

高清Full HD FIFO DRAM的工作原理介绍Full HD FIFO DRAM,顾名思义就是应用于两个主动组件之间的影像暂储存内存.当Write enable写入智能脚位工作启动时,Read-clock 写入频率输入同步启动时,那影像的数据(video data)就会从低到高位输入.在FIFO内部,内存的Address就会从write pointer (写入指标)到read pointer(读出指标)依序排列.当每个读出指标完成动作后,读出指标就会到下一个内存地址继续工作.若在reset 重置状况下,两者指标(write pointer, read pointer) 就会回到第一个内存地址.

Imagination Technologies公司2012 年增长率为业界三倍

Gartner 研究显示,Imagination 是领先的 IP 供应商中增长最快速的公司

Imagination Technologies (IMG.L) 宣布,该公司增长率居 2012 年全球领先的 IP 供应商之首,增长率为整体设计 IP 市场增长率的三倍之多。市场研究机构 Gartner 在 2013 年4 月2 日发布的《市场占有率分析:2012 年全球半导体设计 IP 市场》报告中指出,2012 年全球第三方半导体设计 IP 市场增长率为 11.2%,而 Imagination 的增长率高达 36.4%。日前被 Imagination 并购的 MIPS 科技,其2012 年增长率也同样超越整体市场,为17%。

根据 Gartner 的报告,连续六年来,Imagination 一直是全球第三大的设计 IP 供应商,而且每年的市场占有率均持续增长。MIPS 则位居第四,两家公司在设计 IP 市场的市占率总共为11.3%。

联芯采用Hantro视频IP产品

图片说明图片说明全球基于Hantro视频IP的芯片出货总数已超过10亿颗

芯原股份有限公司(芯原)今天宣布,Hantro G1视频多格式解码器和Hantro H1视频多格式编码器IP成功应用于中国领先的TD-SCDMA和 TDD-LTE通讯技术及解决方案提供商联芯科技有限公司(联芯)的一系列高性能应用处理器产品中。Hantro视频IP助力联芯的产品实现全高清60帧每秒的视频编解码能力,并支持包括VP8(WebM,WebRTC)、H.264、MVC、 MPEG-2/4、DivX、VC-1、RealVideo和AVS等在内的多种视频格式。

Cadence宣布3.8亿美元收购Tensilica

Cadence宣布收购TensilicaCadence宣布收购Tensilica新闻重点:
• Tensilica公司的数据平面处理单元(DPUs)与Cadence公司的设计IP相结合,将为移动无线、网络基础设施、汽车信息娱乐和家庭应用等各方面提供更优化的IP解决方案。
• 作为业界标准处理器架构的补充,Tensilica公司的IP提供了应用优化的子系统,以提高产品的辨识度和更快地进入市场。
• 全球持有Tensilica公司IP授权许可的公司超过200个,包括系统OEM制造商及世界前10大半导体公司中的7家。Tensilica的IP核在全球的总出货量已超过20亿枚。

Cadence Design Systems, Inc.(纳斯达克:CDNS)今天宣布,其已就以约3亿8千万美元的现金收购在数据平面处理IP领域的领导者Tensilica, Inc.达成了一项最终协议。截至2012年12月31日,Tensilica拥有约3千万美元的现金。

赛灵思推出完全自适应千兆位级点对点微波调制解调器IP

自适应千兆位级点对点微波调制解调器IP自适应千兆位级点对点微波调制解调器IP此款1024QAM微波调制解调器IP解决方案将完全可编程的硬件和API软件相结合,支持新一代智能宽带无线解决方案

All Programmable技术和器件的全球领先企业赛灵思公司(Xilinx, Inc. (NASDAQ:XLNX) )今天宣布推出面向回程应用的全新千兆位级1024QAM点对点(PtP)微波调制解调器IP。这款调制解调器解决方案在设计过程中充分采纳了一级OEM厂商的宝贵意见,并采用赛灵思的28nm All Programmable器件。对于无线OEM厂商来说, 这个调制解调器方案代表了一个巨大的机会, 可以支持他们在其低成本高性能微波回程平台中集成差异化、灵活性以及可编程等功能。

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CEVA在CES2013展会上展示用于移动产品、数字家庭和汽车的最新DSP和平台IP

CEVA-XC323 DSPCEVA-XC323 DSP展示技术包括用于先进成像和视觉处理、自然用户界面、音频提升、语音预处理、基于软件之Wi-Fi 802.11ac、卫星导航 (GNSS)和蓝牙 4.0 低功耗技术
CEVA公司宣布将在美国消费电子展 (CES 2013) 上展示一系列瞄准移动、数字家庭和汽车市场的平台IP产品,包括首个采用CEVA-XC323 DSP的基于硅器件的Wi-Fi 802.11ac 和卫星导航(GNSS)实施方案。CES 2013展会将于2013年1月8至11日在美国拉斯维加斯举办,CEVA公司将在Las Vegas Hotel (前称为Las Vegas Hilton) 会议厅举办专门会议,获邀嘉宾可以参观产品演示并与CEVA的工程技术专家和管理团队成员会面。

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视频:Zynq 软件生态系统介绍

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视频向您介绍基于Zynq的软件供应商生态系统,包括操作系统、嵌入式开发工具、IP以及调试解决方案等

视频:使用Vivado IP目录打包VIvado HLS IP

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了解如何使用Vivado IP目录打包您的Vivado HLS IP。该视频向您演示了所有您需要掌握的导出RTL的功能,包括器件与注册码支持,其他可用的格式以及如何在Vivado HLS中启用RTL综合来评估Vivado HLS设计。视频结束将向您演示如何将Vivado HLS IP加入Vivado IP目录。

Altera推出Serial RapidIO IP内核,保证下一代通信基础设施的互操作性

Altera和IDT团队将交付Serial RapidIO® Gen2 MegaCore®功能IP,支持与6.25 Gbaud四通道的互操作性
Altera公司 (NASDAQ: ALTR)今天宣布,开始提供新的Serial RapidIO® Gen2 MegaCore®功能知识产权(IP),满足全球通信基础设施系统日益增长的带宽需求。该IP新解决方案成功实现了所有硬件与最新Integrated Device Technology (IDT®) RapidIO芯片的互操作性,并支持28 nm Altera Stratix® V FPGA,每通路工作速率高达6.25 Gbaud。通过提前验证互操作性,Altera和IDT支持客户采用RapidIO减少接口调试时间,而将重点放在系统设计的核心功能上。

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Synopsys发布DesignWare DDR4存储器接口IP

Synopsys发布DesignWare DDR4存储器接口IPSynopsys发布DesignWare DDR4存储器接口IP内存控制器和PHY可支持多种DDR标准,同时降低延迟与待机功率
亮点:
• Synopsys扩展了其业界领先的DesignWare® DDR存储器接口知识产权(IP)系列,以使其亦可支持DDR4 SDRAM
• 对DDR3和LPDDR2/3移动SDRAM的向后兼容性,为SoC设计师在从一种SDRAM标准向下一种标准过渡时带来了灵活性
• 新推出的DDR4 IP可提供更多功能,同时与其前一代产品相比,延迟降低高达50%
• DDR4内存控制器和PHY之间由一种标准的DFI3.1接口连接,以使各种定制的PHY和控制器之间的连接变得更加流畅

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视频:创建不同类型的项目

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学习如何在Vivado设计套件中创建不同类型的项目,以满足不同类型的使用模型需求。这些使用模型包括:RTL转硬件验证设计流程、综合网表转硬件验证设计流程、独立IP设计、早期I/O布局、导入第三方或ISE项目。更多Vivado辅导资料信息,敬请访问: www.xilinx.com/training/vivado

新思科技和中芯国际推出40纳米低漏电工艺DesignWare IP

推出了15款基于中芯国际40纳米低漏电工艺的IP推出了15款基于中芯国际40纳米低漏电工艺的IP面向中芯国际先进低功耗工艺的Synopsys DesignWare嵌入式存储器、逻辑库和模拟接口IP,可确保移动市场系统级芯片(SoC)的更快速开发。
亮点:
•最新的合作推出了15款基于中芯国际40纳米低漏电(40LL)工艺技术的Synopsys® DesignWare®知识产权(IP),可使设计师更容易地将各项功能集成到先进的低功耗SoC之中
•经过验证的接口物理层IP包括:PCI Express ®、USB和DDR,有助于SoC设计师确保与各种最新标准交互和实现。
•高品质的模拟IP包括:音频编解码器和数据转换器,能够帮助设计师满足对于低功耗和特殊应用SoC的要求。
•运用中芯国际40LL工艺的嵌入式存储器和逻辑库,可使设计团队在速度和能效上优化整个系统级芯片的设计。

CEVA凭借90%的市场份额继续领导DSP IP市场

CEVA继续成为最成功的DSP IP供应商CEVA继续成为最成功的DSP IP供应商著名市场研究机构The Linley Group的报告显示,CEVA占据领先的市场地位;报告也预测业界对可编程DSP的需求将会增加,以期满足多模式基带处理的需求
CEVA公司宣布,被领先的市场研究机构The Linley Group列为2011年全球领先DSP IP付运厂商,占据90%的市场份额。市场份额数据是The Linley Group在题为 “CPU内核和处理器IP指南” (A Guide to CPU Cores and Processor IP) 的报告 (注1)中发布的。

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